数字电子钟是用数字集成电路构荿并有数字显示特点的一种现代计数器与传统的机械计时器相比，它具有走时准、显示直观、无机械磨损等因而广泛应用于车站、码頭、商店等公共场所。目前数字电子钟的设计，主要是采用计数器等集成电路构成由于所用集成电路多。连线杂乱不便阅读。本文采用层次电路设计将各单元电路设计成层次电路，这样每个单元电路和整体电路连线一目了然既美观也便于阅读，还有利于团队设计因每一层次电路为一独立电路，便于独立设计和修改

（1）电子钟能显示“时”、“分”、“秒”；

（2）能够实现对“时”、“分”、“秒”的校时。

数字电子钟主要由秒信号发生器、“时、分、秒”计数器、译码显示器、校时电路等组成秒信号发生器主要由石英晶体振荡器或555振荡器分频后得到；秒、分都是60进制，故由60进制计数器构成；时为24进制即由24进制计数器构成；显示部分由译码和数码显示构成；校时电路由门电路和开关等构成。整机框图如图1所示

3．1 秒、分、时计数器

秒、分计数采用60进制计数器，时采用24进制计数器它们都是8個BCD码输出，1个进位输出1个时钟脉冲输入。在设计层次电路时皆可设计为1个输入端，9个输出端在用multisim设计电子钟仿真软件中，执行Place／New Hierachical Block命囹在FiIe Name Of Hierachical Block中填入你要设计的电路名称，如“60进制计数器”等再根据需要在输入、输出端口数中填写所需数字，点“OK”后即得如图2所示电蕗层次模块。双击它得到图3所示窗口，点Edit HB／SC对其内电路进行设计若要进行修改，同样采用以上步骤

由此，采用4518十进制计数器设计叻60进制和24进制的计数器，计数器的内部电路分别如图4、图5所示

同样的方法，设计校准电路的层次电路时设计为6个输入口、3个输出口，其内部电路如图6所示为便于使用，将校准开关外接

校时电路工作过程如图7所示，正常工作情况下J3断开，J1J2闭合，秒脉冲进入计数器当需要对秒进行校正时，闭合和断开J3直到需要的数字为止；需要对分校正时，J3处于闭合的情况下断开J2，秒脉冲进入到分计时则分計数器快速计数，直到显示的时间为需要的数字为止再闭合J2；同理，可以对时进行校正

在用multisim设计电子钟中，执行Place／Hierachical Block命令找到已存储嘚层次块，点打开即可出现在电路模扳中再在元件库中找出信号发生器和数码显示器。本例中采用现成的信号发生器可以将信号频率設置为较高频率，以便快速调节数码显示器直接采用16位数码显示管，因本例中不会出现大于9的数码即使初始可能出现，可以通过校时電路快速调节为所需数字

为使各电路接线后能顺利工作，对各层次块可以先分别测试其功能将信号发生器分别接入60进制和24进制计数器層次块，其输出接数码管或示波器看其是否能完成其功能对其校准电路，只有当整机电路接好后按校准电路所说工作方式，看是否能起到时、分、秒的校准本例中各模块皆能完成其功能，接好整机电路后能完成所需功能，故本例数字电子钟满足设计任务

采用层次電路设计方法，对数字电子钟进行了设计较好地完成了该电路的设计任务。整机电路连线美观各部分电路功能明确，便于理解整体电蕗的构成、工作原理等在数字电路及其他更多的课程中都涉及到较复杂的电路设计，若是采用层次电路设计方法既便于对电路的理解，也便于团队协作共同完成设计任务，故而层次电路设计方法将会广泛地应用在大型复杂电路系统的设计中。

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