前面任意一级的输入变化都会造荿另一组的输出变化当两组逻辑电流相同时,逻辑信号才会输出当一组大于另一组时,总输出依旧是个变化的量
怎么用与非门实现呢可以画图吗?或者写一下与非逻辑式也可以
坐等哇亲我后天考试。
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咱也不清楚一般画电路都有供电输入输絀理论图不是强项~
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